Interoperabilität von 28-nm-FPGAs mit PCIe Gen3-Switches

Altera hat die Interoperabilität seiner Stratix V GX-FPGAs mit den ExpressLane PCI Express (PCIe) Gen3-Switches von PLX Technology demonstriert. Sie verfügen über Hard PCIe Gen3 IP-Funktionsblöcke und sind, laut Hersteller, die derzeit einzigen FPGAs, die mit einem PCIe Gen3-Switch arbeiten können. Sie bieten bis zu vier Hard PCIe Gen3 x 8 IP-Blöcke. Diese Funktionsblöcke unterstützen Konfigurationen mit x1, x2, x4 und x8 Lanes. Sie bieten Datenraten von bis zu 8Gbit/s je Lane und damit einen doppelt so hohen Durchsatz im Vergleich zur Vorgänger-Generation (Gen3 x 8 im Vergleich zu Gen2 x8). Die Hardware-IP der PCIe-Blöcke in den Stratix V-FPGAs ermöglicht die Einsparung von bis zu 100.000 Logikelementen im Vergleich zu einer Software-Implementierung. Die Hard PCIe Gen3 IP-Blöcke integrieren den PCIe-Protokoll-Stack in das FPGA sowie die Transceiver-Module, Physical-, Data-Link- und Transaction-Layer. Die FPGAs erfüllen die PCIe Base Spezifikationen Rev. 3.0, 2.x und 1.x.
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